设计了基于FPGA并与MCS-51单片机指令兼容的高效微处理器内核.本内核改进了传统MCS-51单片机的体系结构,使每个机器周期只需一个时钟周期,提高了指令的执行效率.同时增加了硬件看门狗及软件复位功能,提高了系统的可靠性和抗干扰能力.本内核通过了功能仿真并下载到FPGA中成功运行. 


基于FPGA的微处理器内核设计与实现.pdf

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